实验包包括：第1关：汉字字库存储芯片扩展实验、2. MIPS寄存器文件设计、第3关：MIPS RAM设计、第4关：全相联cache设计、第5关：直接相联cache设计、第6关：4路组相连cache设计、第7关：2路组相连cache设计。
实验包包括：第1关：汉字字库存储芯片扩展实验、2. MIPS寄存器文件设计、第3关：MIPS RAM设计、第4关：全相联cache设计、第5关：直接相联cache设计、第6关：4路组相连cache设计、第7关：2路组相连cache设计。
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